Orden Importa: Impacto Oculto de Secuencias de Colocación de Macros
OrderPlace, un marco de evolución de LLM guiado por proxy, reduce hasta un 34% la longitud de cable en colocación de macros. Optimiza el diseño de chips!
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Descubre BigPower, un modelo jerárquico que estima el consumo de potencia en CPUs usando LLMs, sin necesidad de simulación. Optimiza el diseño de chips con IA.
SwiftCTS optimiza Clock Tree en segundos: entrena en <5s, predice en microsegundos y reduce errores de potencia al 0.5% con sólo 1-2 ejemplos.
Descubre HighTide: suite Open Source de benchmarks VLSI con curaduría IA. Compilación RTL a GDS incremental con Bazel y caché remota.
El framework LMM-IR usa IA multimodal con transformers y nubes de puntos 3D para predecir caída de IR estática en chips. Acelera el diseño al reducir horas de análisis a minutos.